A 10-bit 250MS/s Pipelined ADC With a Merged S/H & 1st Stage Using an Optimal Opamp Sharing Technique
Publish place: 19th Iranian Conference on Electric Engineering
Publish Year: 1390
نوع سند: مقاله کنفرانسی
زبان: English
View: 1,675
This Paper With 5 Page And PDF Format Ready To Download
- Certificate
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
ICEE19_396
تاریخ نمایه سازی: 14 مرداد 1391
Abstract:
This paper presents a very high-speed low-power 10- bit pipelined ADC in a 90nm CMOS technology. A modifiedopamp-sharing technique is proposed which enables merging the S/H and first stage with optimum power saving. The new technique saves power by changing the bias currents of the input and output stages of the amplifier. Stage scaling and low power dynamic comparators are also utilized to reduce power consumption more effectively. Using this approach, a 10-bit 250MSample/s pipelined ADC has been designed in a 90nm CMOS technology. According to HSPICE simulation results, the ADC achieves a 54.5dB SNDR with a nyquist-rate, 1Vp-p,diff input signal while consuming only 29mW with a 1V supply voltage.
Authors
Mohammad Reza Ashraf
Integrated Circuits Design Laboratory Department of Electrical EngineeringAmirkabir University of TechnologyTehran, Iran
مراجع و منابع این Paper:
لیست زیر مراجع و منابع استفاده شده در این Paper را نمایش می دهد. این مراجع به صورت کاملا ماشینی و بر اساس هوش مصنوعی استخراج شده اند و لذا ممکن است دارای اشکالاتی باشند که به مرور زمان دقت استخراج این محتوا افزایش می یابد. مراجعی که مقالات مربوط به آنها در سیویلیکا نمایه شده و پیدا شده اند، به خود Paper لینک شده اند :