مقایسه کارآیی و توان در الگوریتم های مسیریابی روش NoC
Publish place: 15th Iranian Conference on Electric Engineering
Publish Year: 1386
نوع سند: مقاله کنفرانسی
زبان: Persian
View: 7,719
This Paper With 7 Page And PDF Format Ready To Download
- Certificate
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
ICEE15_288
تاریخ نمایه سازی: 17 بهمن 1385
Abstract:
شبکه های روی تراشه به عنوان جایگزین مناسبی برای روش سیم بندی در رسیدن به کارایی بالا و طراحی پیمانه ای می باشد. بهینگی در مصرف توان یکی از نگرانی های طراحی NOC ها است. الگوریتم های مسیریابی روی توان، تاخیر و مساحت تراشه تاثیر به سزایی دارند. در این مقاله یک مدل سخت افزاری دقیق از یک NOC مبتنی بر مش که با VHDL پیاده سازی شده است، ارائه گردیده و تاخیر الگوریتم های مسیریابی مختلف در آن از طریق شبیه سازی اندازه گیری شده است. همچنین الگوریتم های مورد نظر بر روی FPGA پیاده سازی شده اند تا بتوان ، مساحت و دمای ناشی از پیاده سازی هر الگوریتم را بدست آورد. بررسی های انجام شده نشان داد که الگوریتم گام مثبت بیشترین توان مصرفی و کمترین تاخیر را داراست. در حالی که الگوریتم اول – غرب کمترین توان مصرفی را دارد.
Keywords:
Authors
مهدیه نادی سنجانی
دانشگاه آزاد اسلامی واحد اراک
مهدیار حسین قدیری
دانشگاه آزاد اسلامی واحد اراک
محمدتقی منظوری شلمانی
دانشگاه صنعتی شریف
مراجع و منابع این Paper:
لیست زیر مراجع و منابع استفاده شده در این Paper را نمایش می دهد. این مراجع به صورت کاملا ماشینی و بر اساس هوش مصنوعی استخراج شده اند و لذا ممکن است دارای اشکالاتی باشند که به مرور زمان دقت استخراج این محتوا افزایش می یابد. مراجعی که مقالات مربوط به آنها در سیویلیکا نمایه شده و پیدا شده اند، به خود Paper لینک شده اند :