طراحی تمام جمع کننده CMOS با سرعت بالا و توان مصرفی بهینه برای کاربردهای محاسباتی
عنوان مقاله: طراحی تمام جمع کننده CMOS با سرعت بالا و توان مصرفی بهینه برای کاربردهای محاسباتی
شناسه ملی مقاله: NSOECE01_137
منتشر شده در کنفرانس بین المللی سیستمهای غیر خطی و بهینه سازی مهندسی برق و کامپیوتر در سال 1394
شناسه ملی مقاله: NSOECE01_137
منتشر شده در کنفرانس بین المللی سیستمهای غیر خطی و بهینه سازی مهندسی برق و کامپیوتر در سال 1394
مشخصات نویسندگان مقاله:
محمدحسین مسگراف اسدآبادی - دانشجوی کارشناسی ارشد برق- الکترونیک دانشگاه صنعتی سجاد مشهد
محمدجواد مالکی - دانشجوی کارشناسی ارشد برق- الکترونیک دانشگاه صنعتی سجاد مشهد
عباس گلمکانی - استادیار دانشگاه صنعتی سجاد مشهد
خلاصه مقاله:
محمدحسین مسگراف اسدآبادی - دانشجوی کارشناسی ارشد برق- الکترونیک دانشگاه صنعتی سجاد مشهد
محمدجواد مالکی - دانشجوی کارشناسی ارشد برق- الکترونیک دانشگاه صنعتی سجاد مشهد
عباس گلمکانی - استادیار دانشگاه صنعتی سجاد مشهد
در این گزارش به ارائه سلول تمام جمع کننده با سرعت بالا و توان مصرفی پایین می پردازیم. در اینجا ما از یک ساختار منطقی داخلی و منطق ترانزیستور عبوری که منجر به کاهش PDP می شود استفاده می کنیم. همچنین یک مقایسه با سایر جمع کننده های موجود که PDP کمی دارند، ازنظر سرعت و توان انجام خواهیم داد. طراحی های ما در این قسمت با تکنولوژی0.18um انجام می شود و ایده انجام شده در این مقاله در مقابل %80 بهبود PDP چیزی در حدود 40% افزایش فضا خواهد بود.
کلمات کلیدی: تمام جمع کننده، ترانزیستور عبوری،CMOS ، Ultra-low Power
صفحه اختصاصی مقاله و دریافت فایل کامل: https://civilica.com/doc/383409/