طراحی DDSM و مقسم فرکانسی جهت استفاده در حلقه های قفل فاز
عنوان مقاله: طراحی DDSM و مقسم فرکانسی جهت استفاده در حلقه های قفل فاز
شناسه ملی مقاله: PCCO01_072
منتشر شده در کنفرانس ملی فناوری های نوین در مهندسی برق و کامپیوتر در سال 1396
شناسه ملی مقاله: PCCO01_072
منتشر شده در کنفرانس ملی فناوری های نوین در مهندسی برق و کامپیوتر در سال 1396
مشخصات نویسندگان مقاله:
فاطمه عروجی - دانشجوی کارشناسی ارشد، دانشگاه آزاد اسلامی واحد اراک
سید علی سادات نوری - مربی گروه برق-الکترونیک، دانشگاه آزاد اسلامی واحد شوشتر
اشکان حری - مربی گروه برق- الکترونیک، دانشگاه آزاد اسلامی واحد اراک
خلاصه مقاله:
فاطمه عروجی - دانشجوی کارشناسی ارشد، دانشگاه آزاد اسلامی واحد اراک
سید علی سادات نوری - مربی گروه برق-الکترونیک، دانشگاه آزاد اسلامی واحد شوشتر
اشکان حری - مربی گروه برق- الکترونیک، دانشگاه آزاد اسلامی واحد اراک
مدار مدولاتور سیگما-دلتا دیجیتال طراحی شده در این مقاله ، با استفاده از جمع کننده دیجیتال و TSPC D-FF انجام شده است. همچنین از مدولاتور سیگما- دلتا تک کوانتایزر استفاده کرده ایم. نقلی خروجی ، تک بیتی است و با تغییر صفر و یک ، نسبت تقسیم مقسم فرکانسی تغییر می کند. همچنین مقسم فرکانسی با سرعت بالا و توان کم طراحی شده است. شبیه سازی در تکنولوژی 0/18 μm منطق CMOS و با استفاده از نرم افزار ADS صورت پذیرفت. نتایج حاصل از مدار مذکور از نقطه نظر توان مصرفی 2/5 mw و تاخیر ، بهبود نسبی پیدا کرده است و این امر به سبب بهره گیری از مداراتی با تعداد کمتر ادوات mos و ساختار TSPC می باشد
کلمات کلیدی: مدولاتور سیگما-دلتا دیجیتال ، مقسم فرکانسی ، جمع کننده دیجیتال ، فلیپ-فلاپ D توان کم
صفحه اختصاصی مقاله و دریافت فایل کامل: https://civilica.com/doc/758625/