طراحی، شبیه سازی و ارزیابی یک سلول تمام جمع کننده سه ارزشی برمبنای ترانزیستورهای نانولوله کربنی نسخه چهار: بهبود سرعت، مصرف توان و تحملپذیری نویز
Publish place: The National Conference on 2041 Vision and Technological Developments in Electrical Engineering, Computer, and Information Technology
Publish Year: 1396
نوع سند: مقاله کنفرانسی
زبان: Persian
View: 486
This Paper With 10 Page And PDF Format Ready To Download
- Certificate
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
ECITCONF01_068
تاریخ نمایه سازی: 29 مهر 1396
Abstract:
با توجه به لزوم ادامه روند مجتمع سازی با بهره گیری از فناوری های نوین و نقش بی بدیل جمع کننده ها در سیستم های VLSI و همچنین مزایای بیشمار منطق چند ارزشی، دستاوردهای این مقاله در راستای بهبود بخشیدن به سرعت، مصرف توان و حاشیه نویز جمع کنندههای سه ارزشی مبتنی بر ترانزیستورهای نانولوله کربنی هدف گذاری شده است. در این میان اما کاهش حاشیه نویز بر اثر استفاده از منطق چند ارزشی قابل تامل به نظر می رسد، لذا لزوم استفاده حداکثری از فضای ولتاژ کاری و فراهم آوردن حداکثر بازه قابل دسترس برای هر منطق به فراخور ظرفیت های موجود به منظور افزایش تحمل پذیری مدار در برابر نویز ضروری به نظر می رسد. از این رهگذر بر آن شدیم تا طرح پیشنهادی نه تنها دارای تاخیر و توان مصرفی مناسب باشد، بلکه از مصونیت مناسبی در برابر نویز نیز برخوردار باشد. در کنار این موضوع، ما بر روابط ریاضی حاکم بر ترانزیستورهای نانولوله کربنی نیز مروری خواهیم داشت.
Keywords:
نانوتکنولوژی (Nanotechnology) , ترانزیستور نانولوله کربنی (CNTFET) , منطق چند ارزشی (MVL) , جمع کننده (Full Adder) , منطق سه ارزشی (Ternary)
Authors
مهراد آفرین
کارشناسی ارشد مهندسی کامپیوتر معماری سیستم های کامپیوتری، دانشگاه آزاد اسلامی واحد شهرری