From A 38 mW 12b 100 MS/s Pipelined ADC Design to Less Than a 20 mW One
Publish place: 9th Iranian Student Conference on Electrical Engineering
Publish Year: 1385
نوع سند: مقاله کنفرانسی
زبان: English
View: 1,597
This Paper With 7 Page And PDF Format Ready To Download
- Certificate
- من نویسنده این مقاله هستم
استخراج به نرم افزارهای پژوهشی:
شناسه ملی سند علمی:
ISCEE09_083
تاریخ نمایه سازی: 13 اسفند 1386
Abstract:
A 12 bit pipelined ADC blocks are designed in 0.35 μm mixed-mode CMOS process. The final ADC conversion rate is 100 MS/s while the main circuits consumes only 38 mW power from a 3 V voltage supply. A wide swing gain-boosting technique, is used to design high dc gain and high unity gain bandwidth opamps. Also a technique is presented to reduce the power up to 20 mW.
Authors
Mohammad Reza Ghdarei Karkani
IEEE student member
مراجع و منابع این Paper:
لیست زیر مراجع و منابع استفاده شده در این Paper را نمایش می دهد. این مراجع به صورت کاملا ماشینی و بر اساس هوش مصنوعی استخراج شده اند و لذا ممکن است دارای اشکالاتی باشند که به مرور زمان دقت استخراج این محتوا افزایش می یابد. مراجعی که مقالات مربوط به آنها در سیویلیکا نمایه شده و پیدا شده اند، به خود Paper لینک شده اند :